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[主观题]

模型机数据通路结构由CPU内总线、逻辑运算部件ALU、输入选择器A和B、输出移位器、通用寄存器R0~R3、暂

存器C和D、地址寄存器MAR、数据缓冲寄存器MDR、指令寄存器IR、程序计数器PC、堆栈指针SP组成。(电子科大2006) (1)模型机传送指令MOV(R0),(SP)+;其源采用自增型寄存器间址,目的采用寄存器 间址。用寄存器传送语句(如PC→MAR)拟出该指令的流程。 (2)转移指令JMP X(PC);转移地址采用相对寻址,位移量存放在现行指令所在单元的下一个单元中,以位移量地址为基准进行转移。该指令的流程如下。读懂该流程,并为每题选择一个正确答案。 取指周期FT:M→IR IR的内容为______________ PC+1→PC PC的内容为______________ 执行周期ET:PC→MAR MAR的内容为______________ M→MDR→C C的内容为______________ PC+C→PC MAR的内容为______________ ①现行指令 ②下条指令 ③源操作效 ④位移量 ⑤源地址 ⑥位移量地址 ⑦现行指令地址 ⑧转移地址

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更多“模型机数据通路结构由CPU内总线、逻辑运算部件ALU、输入选择器A和B、输出移位器、通用寄存器R0~R3、暂”相关的问题

第1题

某机数据通路结构如图所示,其中含有:ALU,通用寄存器R0~R3,堆栈指针,暂存器C、D,程序计数器PC,
指令寄存器IR,地址寄存器MAR,数据缓冲寄存器MBR,选择器A、B等。欲读并执行一条加法指令ADD(R0),(R1);源在后,目的在前,源寻址方式为寄存器间址方式,目的寻址方式为寄存器间址方式;请描述其指令流程。

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第2题

某假想机主要部件如图9.11所示,其中: LA ALU的A输入端选择器 LB ALU的B输
入端选择器 M 主存 MDR 主存数据寄存器 IR 指令寄存器 MAR 主存地址寄存器 PC 程序计数器 R0~R3 通用寄存器 C、D 暂存器

(1)补充各种部件之间的主要连接线,并注明数据流动方向。 (2)写出ADD @R1,@R2和SUB @R1,@R2指令取指阶段和执行阶段的信息流程。R1寄存器中存放源操作数的地址,R2寄存器中存放的是目的操作数的地址。

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第3题

某假想机主要部件如图9.11所示,其中:LAIALU的A输入端选择器LB ALU的B输入端选择器M 主存MDR
某假想机主要部件如图9.11所示,其中:

LAIALU的A输入端选择器

LB ALU的B输入端选择器

M 主存

MDR 主存数据寄存器

IR指令寄存器

MAR主存地址寄存器

PC程序计数器

R0~R3通用寄存器

C、D暂存器

(1)补充各种部件之间的主要连接线,并注明数据流动方向。.

(2)写出ADD @R1,@R2和SUB @R1,@ R2指令取指阶段和执行阶段的信息流程。R1寄存器中存放源操作数的地址,R2寄存器中存放的是目的操作数的地址。

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第4题

某模型机的通路结构如下图所示,用寄存器传送语句(如PC→MAR),拟出下列指令从读取到执行的完整流程
某模型机的通路结构如下图所示,用寄存器传送语句(如PC→MAR),拟出下列指令从读取到执行的完整流程。

(1)数据传送指令MOV X(R0),Y(R1),源和目的操作数地址均采用变址寻址,第1个参数X为源操作数的形式地址,第2个参数为目的操作数的形式地址,分别位于指令的第2个和第3个存储字。

(2)数据求反指令COM一(R0),采用自减型寄存器间接寻址,结果送回自减后的地由E单元。

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第5题

某计算机有如下部件:ALU,移位器,主存M,主存数据寄存器MDR,主存地址寄存器MAR,指令寄存器IR,通用寄存器R0-R3,暂存器C和D。(1)请将各逻辑部件组成一个数据通路,并标明数据流动方向。(2)画出“ADDR1,R2”指令的指令周期流程图。(3)请述说RISC指令系统和CISC指令系统的区别及应用?

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第6题

在一条单总线结构的计算机中,用一条总线连接了指令寄存器IR、程序计数器PC 、存储器地址寄存
器MAR、存储器数据寄存器MDR、通用寄存器R0~R7的输人和输出端。ALU的两个输入端分别与总线和寄存器Y的输出端相连,ALU的输出端与寄存器Z的输人端相连。Y的输入端与总线连接,Z的输出端与总线连接。该机有下列指令:

写出控制器执行上述指令的微操作及节拍安排。

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第7题

CPU执行算术运算或者逻辑运算时,算术逻辑运算部件(ALU)将计算结果保存在(2) 中。

A.累加器(A)

B.程序计数器(PC)

C.指令寄存器(IR)

D.地址寄存器(AR)

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第8题

主存地址寄存器MAR的位数与下列哪个寄存器相同?()。A.主存数据寄存器MDRB.程序计数器PCC.指令寄存
主存地址寄存器MAR的位数与下列哪个寄存器相同?()。

A.主存数据寄存器MDR

B.程序计数器PC

C.指令寄存器IR

D.累加器AC

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第9题

已知单总线计算机结构如图9.7所示,其中XR为变址寄存器,EAR为有效地址寄存器,LATCH为暂存器。假
设指令地址已存于PC中,画出ADD * D指令周期信息流程图,并列出相应的控制信号序列。

说明:

(1)ADD*D指令字中*表示相对寻址,D为相对位移量。

(2)寄存器的输入和输出均受控制信号控制,如PCi表示PC的输入控制信号,又如MDR0表示MDR的输出控制信号。

(3)凡是需要经过总线实现寄存器之间的传送,需在流程图中注明,如PC→Bus→MAR,相应的控制信号为PC0和MARi。

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