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[主观题]

设计一个可控同步计数器,M1、M2为控制信号,要求: (1)M1M2=00时,维持原状态; (2)M1M2=01时,实现模2计数; (

设计一个可控同步计数器,M1、M2为控制信号,要求:

(1)M1M2=00时,维持原状态;

(2)M1M2=01时,实现模2计数;

(3)M1M2=10时,实现模4计数;

(4)M1M2=11时,实现模8计数。

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更多“设计一个可控同步计数器,M1、M2为控制信号,要求: (1)M1M2=00时,维持原状态; (2)M1M2=01时,实现模2计数; (”相关的问题

第1题

试设计一个可控模同步计数器,它具有表5-27所示的功能。 表5-27 可控模同步计数器功能表

试设计一个可控模同步计数器,它具有表5-27所示的功能。

表5-27 可控模同步计数器功能表

M1

M2

功能

0

0

保持

0

1

模2计数

1

0

模4计数

1

1

模8计数

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第2题

分别用相关器件和VHDL语言设计一个可控同步计数器,要求: 在M=0时,按加1顺序(0→1→2→…)计数,并实现模5计数器
分别用相关器件和VHDL语言设计一个可控同步计数器,要求:

在M=0时,按加1顺序(0→1→2→…)计数,并实现模5计数器;在M=1时,按加2顺序(0→2→4→1→…)计数,并实现模5计数器。

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第3题

用PLA和J-K触发器实现一个模8的同步可逆计数器。当控制端X=1时,为加计数;当X=0时,为减计数。
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第4题

用十进制数中规模计数器设计一个可控计数器,当控制信号X=0时为模6计数,X=1时为模8计数,计数状态可以自己选

择。说明设计过程,画出逻辑图。

以上设计可以使用外加的逻辑门。

下表是十进制中规模计数器的功能表。

RESETbar{LOAD}CLKQDQCQBQA11φ复位全0状态φ0↑预置φ1↑加计数

计数器还有进位输出F端,当加计数剑1001状态时产生进位负脉冲输出。

计数器的逻辑符号如图所示。

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第5题

设计一同步二进制码计数器,当控制信号X=0时做模M=4的加法计数,当X=1时做模M=3的加法计数。
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第6题

试用74160设计双模计数器,由M控制计数模值,当M=0和M=1时分别实现模6和模8计数。
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第7题

试用JK触发器设计一个变模计数器,要求: (1)控制端X=0时,计数器的模M=3,计数规律为
试用JK触发器设计一个变模计数器,要求: (1)控制端X=0时,计数器的模M=3,计数规律为

(2)控制端X=1时,计数器的模M=4,计数规律为

试画出逻辑电路图。

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第8题

试用D触发器设计一个异步二进制模8加/减计数器。当控制信号X=0时,计数器进行加法计数,反之做减法计数。
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第9题

用GAL器件实现模可变的同步计数器,当控制信号M=0时为模七进制计数器,当M=1时,实现模五进制计数器。

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