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[判断题]

CMOS门电路输入端悬空可当成逻辑0处理。()

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发布时间：2022-05-21

更多“CMOS门电路输入端悬空可当成逻辑0处理。()”相关的问题

第1题

CMOS门电路的输入端悬空时相当于输入为逻辑1.（)

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第2题

CMOS门电路中不用的输入端不允许悬空通过大电阻接地的输入端相当于高电平。（)

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第3题

CMOS逻辑门在使用时，多余的输入端不允许悬空。（)

CMOS逻辑门在使用时，多余的输入端不允许悬空。()

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第4题

CMOS门电路的输入端通过电阻Ri=10KW接地，则输入端相当于接高电平。()

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第5题

图L3－7（a)～（e)所示的CMOS门电路，试分析其输出端的逻辑状态，并总结CMOS门电路的输入端负载特性。（其中VIL=0.8

图L3-7(a)～(e)所示的CMOS门电路，试分析其输出端的逻辑状态，并总结CMOS门电路的输入端负载特性。(其中V_IL=0.8V，V_DD=5V)

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第6题

TTL门电路和CMOS门电路的输入特性有何区别？为什么CMOS电路的输入端不允许悬空，而TTL电路的输入端不准串接大电阻？

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第7题

TTL集成电路和CMOS集成电路对输入端的空脚处理为（)

A.全部接地

B.CMOS允许悬空

C.TTL允许悬空

D.CMOS不允许悬空

E.TTL不允许悬空

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第8题

CMOS门电路输入端不能悬空，否则容易击穿损坏，是否正确（）

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第9题

CMOS门电路的闲置输入端应该接地。（）

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第10题

或门电路中，输入端若有一个为低电平0，则输出端必为1。（）

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第11题

或门电路中，输入端若有一个为低电平0，则输出端必为高电平1。（）

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