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[单选题]
VHDL语言是一种结构化设计语言;一个设计实体(电路模块)包括实体与结构体两部分,结构体描述()。
A.器件外部特性
B.器件的内部功能
C.器件的综合约束
D.器件外部特性与内部功能
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A.器件外部特性
B.器件的内部功能
C.器件的综合约束
D.器件外部特性与内部功能
第1题
A.器件外部特性
B.器件的内部功能
C.器件的综合约束
D.器件外部特性与内部功能
第5题
用VHDL语言设计上题的4-16线译码器,要求: (1)用行为描述方法实现设计; (2)用结构描述方法实现设计。
第7题
A.程序流程图是一种算法描述工具
B.PAD图是一种描述程序逻辑结构的工具
C.过程设计语言是一种用于描述模块算法设计和处理细节的语言
D.PAD图是一种由左往右展开的二维型结构
第9题
若输入为3位二进制数X=x2x1x0,分别用逻辑门和VHDL语言设计一个输出Y=X2的组合电路。
第10题
A.原理图式设计方法
B.VHDL语言描述设计方法
C.Verilog语言描述设计方法
D.在非嵌入式开发中,利用纯C语言设计描述