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[主观题]

一个4体低位交叉的存储器,假设存储周期为T, CPU每隔1/4存取周期启动-个存储体，试问依次访问64个字需多少个存取周期？

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发布时间：2021-07-21

更多“一个4体低位交叉的存储器,假设存储周期为T, CPU每隔1/4存取周期启动-个存储体，试问依次访问64个字需多少个存取周期？”相关的问题

第1题

一个四体并行的低位交叉编址存储器，每个存储体的存取周期为200 ns，总线传输周期为50 ns，则连续读

取10个存储字需时()。

A．2000 ns

B．600 ns

C．650 ns

D．300 ns

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第2题

设有8个模块组成的八体存储器结构，每个模块的存取周期为400 ns，存储字长为32位。数据总线宽度为32

位，总线传输周期50 ns，试求顺序存储(高位交叉)和交叉存储(低位交叉)的存储器带宽。

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第3题

已知单个存储体的存储周期为110ns，总线传输周期为10ns，则当采用低位交叉编址的多模块存储器时，存

储体数应（）。

A．小于11

B．等于11

C．大于11

D．大于等于11

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第4题

由一个具有8个存储体的低位多体交叉存储体中，如果处理器的访存地址为以下八进制值。求该存

1 由一个具有8个存储体的低位多体交叉存储体中，如果处理器的访存地址为以下八进制值。求该存储器比单体存储器的平均访问速度提高多少(忽略初启时的延时)？ (1)1001，1002，1003，1004, 1005…, 1100 (2)1002，1004，1006，1010, 1012…. 1200 (3)1003，1006，1011，1014, 1017…, 1300

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第5题

设有一个四体低位交叉的存储器，每个体的容量为256K×64位，存取周期为200 ns。则数据总线的宽度为__

______位，总线传送周期的最大值是________ns。CPU连续读4个字所需的最多时间是________ns。

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第6题

（11 分）假设某计算机的 CPU 主频为 80MHz，CPI 为 4，并且平均每条指令访存 1.5 次，主存与 Cache

之间交换的块大小为 16B，Cache 的命中率为 99%，存储器总线宽度为 32 位。请回答下列问题。（1）该计算机的 MIPS 数是多少？平均每秒 Cache 缺失的次数是多少？在不考虑 DMA 传送的情况下。主存带宽至少达到多少才能满足 CPU 的访存要求？（2）假定在 Cache 缺失的情况下访问主存时，存在 0.0005%的缺页率，则 CPU 平均每秒产生多少次缺页异常？若页面大小为 4KB，每次缺页都需要访问磁盘，访问磁盘时 DMA 传送采用周期挪用方式，磁盘 I/O 接口的数据缓冲寄存器为 32 位，则磁盘 I/O 接口平均每秒发出的 DMA 请求次数至少是多少？（3）CPU 和 DMA 控制器同时要求使用存储器总线时，哪个优先级更高？为什么？（4）为了提高性能，主存采用 4 体低位交叉存储器，工作时每 1/4 周期启动一个存储体，每个存储体传送周期为 50ns，则主存能提供的最大带宽是多少？

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第7题

有一个容量为16K×32的存储器。请问这个存储器可以存储多少个字？每个字的位数是多少？这个存储器包含多少个存

储单元？

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第8题

8086CPU从偶地址访问内存1个字时需占用个总线周期，而从奇地址访问内存1个字操作需占用个总线周期。

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第9题

下列说法不正确的是（)。A．单体多字存储器能提高存储器频宽B．多体存储器低位交叉编址能提高存

下列说法不正确的是()。

A．单体多字存储器能提高存储器频宽