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图13.17所示是由两个JK触发器组成的时序逻辑电路，设开始时Q1=0，Q2=0。(1)写出两个触发器的翻转条件，画出Q2和Q1的波形图；(2)说明它是几进制计数器，是加法计数器还是减法计数器？是同步计数器还是异步计数器？
答案
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第1题
第2题
第3题
逻辑电路如图所示，列出状态表，已知C脉冲波形，画出输出Q0、Q1的波形，判断该计数器是几进制计数器，是加法还是减法？是异步还是同步？(设Q0、Q1的初始状态均为“0”)。
第4题
(1)分别画出它们的状态图；
(2)说明它们各为几进制计数器，是加法计数器还是减法计数器。
第5题
现有两个D触发器和两个JK触发器，如图10.19(a)所示。试用它们组成四位二进制异步加法计数器，并画出正确的连接线路图。
第6题
A.异步式和加法计数器
B.异步式和减法计数器
C.异步式和可避计数器
D.异步式和同步式。
第8题
采用JK触发器设计具有自启动特性的同步五进制计数器，状态转移表如表所示，画出计数器逻辑图。
