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[主观题]

用16K×1位的DRAM芯片构成64K×8位的存储器，设存储器的读写周期为0.5μs，要使CPU在1μs内至少访问存储器一次，问采用哪种刷新方式比较合适？若每行刷新间隔不超过2ms，该方式下刷新信号的间隔是多少？

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发布时间：2021-07-20

更多“用16K×1位的DRAM芯片构成64K×8位的存储器，设存储器的读写周期为0.5μs，要使CPU在1μs内至少访问存储器一次，问采用哪种刷新方式比较合适？若每行刷新间隔不超过2ms，该方式下刷新信号的…”相关的问题

第1题

某机器的寻址空间为64K，数据总线为8位。现有8K×8位SRAM芯片，SRAM有CS和WE控制信号；4K×8位DRAM芯片

，DRAM有CS、wE等控制信号，数据总线是双向。CPU有MERQ、R／W等控制信号(表示低电平有效)。 (1)写出DRAM控制器内部的逻辑部件名称； (2)从0000H开始安排32K×8位SRAM，从A000H安排8K×8位DRAM，画出CPU的DRAM存储器连接电路图(包括74LS138等组成的片选电路、DRAM控制器，DRAM控制器仅要求画出输入、输出信号)； (3)设DRAM读／写周期为0．5μs，CPU在1μs内要访问内存1次或2次，平均1μs访存约1．2次，刷新周期为2ms。有哪几种刷新方式，采用哪种刷新方式比较合理，并说明采用的刷新方式的时间参数和理由。

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第2题

一个1Kx4位的动态RAM芯片,若其内部结构排列成64x64形式，且存取周期为0.1 μs。（1)若采用分散刷新和集中刷新相结合的方式,刷新信号周期应该取多少？（2)若采用集中刷新,则对该存储芯片刷新一遍需多少时间？死时间率是多少？

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第3题

某16位微型机主存地址码为24位，按字节编址，使用1M×1位的DRAM芯片组成，存储周期为0．1μs，请问该机

所允许的最大主存空间是多少？需用多少片DRAM芯片？若采用异步刷新方式，设存储元刷新最大间隔时间不超过8ms，则刷新定时信号的间隔时间是多少？

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第4题

某16位微型机主存地址码为24位，按字节编址，使用1M×1位的DRAM芯片组成，存储周期为0.1us，请问该机

所允许的最大主存空间是多少？需用多少片DRAM芯片？若采用异步刷新方式，设存储元刷新最大间隔时间不超过8ms，则刷新定时信号的间隔时间是多少？

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第5题

一光栅扫描图形显示器，分辨率为800×600，可显示32位真彩色，刷新频率为72Hz，问：（1)刷新存储器容量至少需要多少MB？（2)每一个像素允许的读出时间是多少ns？（3)设总带宽的60%用于刷新屏幕，保留40%带宽用于其他非刷新功能，则刷新存储器的总带宽应是多少？

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第6题

一个8Kx8位的动态RAM芯片,其内部结构排列成256x256形式，存取周期为0.1μs。试问采用集中刷新、分散刷新和异步刷新3种方式的刷新间隔各为多少？

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第7题

动态存储器为什么要进行刷新？采用哪种刷新方式可以既不影响CPU访存，又不影响存取周期？如何安排？

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第8题

设有32片256K×1位的SRAM芯片，问：（1)采用位扩展方法可构成多大容量的存储器？（2)该存储器需要

设有32片256K×1位的SRAM芯片，问： (1)采用位扩展方法可构成多大容量的存储器？ (2)该存储器需要多少字节地址位？ (3)画出该存储器与CPU连接的结构图，设CPU的接口信号有地址信号、数据信号、控制信号MREQ和R／W。

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第9题

一个1K×4位的动态RAM芯片，若其内部结构排列成64×64形式，且存取周期为0．1μs。（1)若采用分散

一个1K×4位的动态RAM芯片，若其内部结构排列成64×64形式，且存取周期为0．1μs。 (1)若采用分散刷新和集中刷新相结合的方式，刷新信号周期应该取多少？ (2)若采用集中刷新，则对该存储芯片刷新一遍需多少时间？死时间率是多少？

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