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[判断题]
CMOS门电路中输入端悬空作逻辑O使用()
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第5题
A.输入端悬空将造成门电路损坏。
B.输入端悬空时相当于接低电平。
C.输入端悬空时相当于接高电平。
D.输入端悬空对门电路工作无影响。
第7题
图L3-7(a)~(e)所示的CMOS门电路,试分析其输出端的逻辑状态,并总结CMOS门电路的输入端负载特性。(其中VIL=0.8V,VDD=5V)
第10题
第11题
A.具有推拉式输出端的TTL门电路
B.TTL电路中OC逻辑门
C.具有推拉式输出端的CMOS门电路
D.CMOS电路中开漏输出的逻辑门